Cómo utilizar Verilog y 3 Basys para hacer contador binario de 3 bits (7 / 11 paso)

Paso 7: Paso 7: sintetizar el diseño

Destacar el "módulo de la tapa" en el panel fuente. Sintetizar el diseño. Ir al navegador de flujo para hacer clic en "Ejecutar síntesis".

Haga clic en la ficha mensaje ver ninguna advertencia o error. En este proyecto, hay cesión de advertencias para cx a la constante. Puede ignorarlos ya que no afectará a la aplicación.

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