Juego de corredor en VHDL (6 / 10 paso)

Paso 6: Píxeles reloj

Hay muchas señales de reloj diferentes en este proyecto. Uno de los relojes principales era el pixel_clock. Necesitábamos un reloj que se generan en 25.185 Hz. Hemos utilizado el generador de base incluido en la Suite de diseño de ISE para crear un reloj para nosotros. Entramos a nuestra frecuencia de Hz 25,185 reloj deseado y utilizado el VHDL creado como nuestro pixel_clock.

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