"Serpiente" en una FPGA

Este proyecto fue terminado para la clase ECE2220, en la Universidad de Manitoba, en el plazo de 2015 de la caída. El tablero utilizado durante todo el proyecto es un tablero Altera DE2 ciclón IV. La codificación se realiza con Verilog HDL vía Quartus II.

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"Serpiente" es un juego simple donde el usuario controla a una serpiente comer artículos generados en ubicaciones al azar en el área de juego. La serpiente se hace más larga y más difícil de controlar cuanto más artículos que consume. Pierdes si choca la cabeza de la serpiente con su propio cuerpo, o si la serpiente golpea una de las fronteras.

El juego se originó en el juego de arcade de 1976 bloqueo [1], y variaciones sobre el juego de hoy son todavía alrededor. Por ejemplo, en la Web de YouTube, puedes jugar snake en un vídeo mientras carga, y Google ha hecho un garabato en el que se puede jugar una versión ligeramente actualizada de serpiente.

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Los cuatro colaboradores para este proyecto son:

Estudiantes de ingeniería de la computación: Daniel Lovegrove, Ian Sweetland

Los estudiantes de ingeniería eléctrica: Kristjan Jacobson, Roberto Alves

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Qué se necesita para replicar este proyecto:

-Altera DE2-115 tablero

-Monitor & cable del VGA

-Teclado PS/2 (un teclado USB con un adaptador de PS/2 puede o no puede trabajar, no cuenta con él)

-Cable USB para cargar el programa a la Junta

-Cable para tablero

-Quartus II Software para editar y abrir el código de Verilog

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Los pasos posteriores se explican las características del juego y explicar VGA teclado salida entrada para dar a futuros estudiantes una mejor idea de cómo funcionan y cómo implementarlos en sus propios proyectos. Estas fueron las partes más difíciles del proyecto que hacer, porque no hay una gran cantidad de información útil en internet para la implementación de estas funciones con Verilog.

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** Principalmente, este instructable intenta ser una Guía concisa para futuros amantes del proyecto que necesitan una referencia para varios módulos y entender más de las funciones de la Junta de la FPGA.

[El código fuente está en la última página (referencias)]

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